AD9626：高性能低功耗12位ADC的卓越之選

在電子設(shè)計(jì)領(lǐng)域，高性能、低功耗的模數(shù)轉(zhuǎn)換器（ADC）一直是工程師們追求的目標(biāo)。今天，我們就來(lái)深入了解一款由ADI推出的12位ADC——AD9626，它在多個(gè)方面展現(xiàn)出了出色的性能和獨(dú)特的優(yōu)勢(shì)。

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產(chǎn)品概述

AD9626是一款經(jīng)過(guò)優(yōu)化的12位單片采樣模數(shù)轉(zhuǎn)換器，以高性能、低功耗和易用性為設(shè)計(jì)理念。它能夠在高達(dá)250 MSPS的轉(zhuǎn)換速率下工作，為寬帶載波和寬帶系統(tǒng)提供了卓越的動(dòng)態(tài)性能。芯片集成了包括跟蹤保持（T/H）和電壓參考等必要功能，為信號(hào)轉(zhuǎn)換提供了完整的解決方案。

關(guān)鍵特性

1. 出色的動(dòng)態(tài)性能
   • 高信噪比（SNR）：在250 MSPS采樣率下，當(dāng)輸入頻率（fIN）高達(dá)70 MHz時(shí)，SNR可達(dá)64.8 dBFS，有效位數(shù)（ENOB）為10.5位。這意味著它能夠在高采樣率下準(zhǔn)確地捕捉信號(hào)，減少噪聲干擾，為后續(xù)的信號(hào)處理提供高質(zhì)量的數(shù)據(jù)。
   • 高無(wú)雜散動(dòng)態(tài)范圍（SFDR）：同樣在250 MSPS采樣率和fIN高達(dá)70 MHz的條件下，SFDR達(dá)到80 dBc，能夠有效抑制雜散信號(hào)，保證信號(hào)的純凈度。
   • 優(yōu)秀的線性度：典型的微分非線性（DNL）為±0.3 LSB，積分非線性（INL）為±0.7 LSB，確保了轉(zhuǎn)換的準(zhǔn)確性和穩(wěn)定性。
2. 靈活的輸出配置
   • CMOS輸出：提供了與現(xiàn)代FPGA技術(shù)兼容的接口，方便工程師進(jìn)行系統(tǒng)設(shè)計(jì)。
   • 可選輸出數(shù)據(jù)格式：支持偏移二進(jìn)制、二進(jìn)制補(bǔ)碼和格雷碼三種輸出格式，滿足不同應(yīng)用的需求。
3. 低功耗設(shè)計(jì)
   • 在170 MSPS采樣率下，功耗僅為272 mW；在250 MSPS采樣率下，功耗為364 mW。低功耗特性不僅降低了系統(tǒng)的能耗，還減少了散熱需求，提高了系統(tǒng)的可靠性。
4. 集成功能豐富
   • 內(nèi)部參考電壓：芯片自帶參考電壓，無(wú)需外部去耦電容，簡(jiǎn)化了電路設(shè)計(jì)。
   • 集成輸入緩沖和跟蹤保持：能夠有效處理輸入信號(hào)，提高轉(zhuǎn)換的準(zhǔn)確性。
   • 時(shí)鐘占空比穩(wěn)定器：可以在較寬的時(shí)鐘占空比范圍內(nèi)保持動(dòng)態(tài)性能，減少時(shí)鐘信號(hào)的影響。

性能參數(shù)

直流參數(shù)

交流參數(shù)

應(yīng)用領(lǐng)域

• 無(wú)線和有線寬帶通信：在高速數(shù)據(jù)傳輸系統(tǒng)中，AD9626能夠準(zhǔn)確地采集和轉(zhuǎn)換信號(hào)，保證通信的質(zhì)量和穩(wěn)定性。
• 電纜反向路徑：用于電纜電視等系統(tǒng)中，實(shí)現(xiàn)信號(hào)的反向傳輸和處理。
• 通信測(cè)試設(shè)備：為測(cè)試設(shè)備提供高精度的信號(hào)采集功能，確保測(cè)試結(jié)果的準(zhǔn)確性。
• 雷達(dá)和衛(wèi)星子系統(tǒng)：在雷達(dá)和衛(wèi)星通信中，對(duì)信號(hào)的實(shí)時(shí)性和準(zhǔn)確性要求較高，AD9626能夠滿足這些需求。
• 功率放大器線性化：幫助功率放大器實(shí)現(xiàn)線性化，提高系統(tǒng)的效率和性能。

設(shè)計(jì)要點(diǎn)

模擬輸入和電壓參考

• 模擬輸入采用差分緩沖方式，為了獲得最佳動(dòng)態(tài)性能，驅(qū)動(dòng)VIN+和VIN - 的源阻抗應(yīng)匹配，以確保共模建立誤差對(duì)稱(chēng)。
• 內(nèi)部差分電壓參考定義了ADC核心的1.25 V p - p固定跨度，并且可以通過(guò)SPI控制進(jìn)行調(diào)整。在不同的應(yīng)用場(chǎng)景中，可以根據(jù)需要選擇合適的輸入配置，如使用AD8138差分驅(qū)動(dòng)器或差分變壓器耦合等方式。

時(shí)鐘輸入

• 為了實(shí)現(xiàn)最佳性能，AD9626的采樣時(shí)鐘輸入（CLK+和CLK - ）應(yīng)采用差分信號(hào)。可以通過(guò)變壓器或電容進(jìn)行交流耦合，這些引腳內(nèi)部有偏置，無(wú)需額外的偏置電路。
• 時(shí)鐘占空比穩(wěn)定器（DCS）可以在較寬的時(shí)鐘占空比范圍內(nèi)保持動(dòng)態(tài)性能，但在某些應(yīng)用中可能需要關(guān)閉該功能，需要注意其對(duì)動(dòng)態(tài)范圍性能的影響。同時(shí)，高分辨率ADC對(duì)時(shí)鐘抖動(dòng)較為敏感，應(yīng)選擇低抖動(dòng)的時(shí)鐘源，并將時(shí)鐘驅(qū)動(dòng)器的電源與ADC輸出驅(qū)動(dòng)器的電源分開(kāi)，以避免數(shù)字噪聲對(duì)時(shí)鐘信號(hào)的調(diào)制。

電源和接地

• 建議使用兩個(gè)獨(dú)立的電源，分別為模擬（AVDD，標(biāo)稱(chēng)1.8 V）和數(shù)字（DRVDD，標(biāo)稱(chēng)1.8 V）供電。如果只有一個(gè)1.8 V電源，可以先將其連接到AVDD，然后通過(guò)鐵氧體磁珠或?yàn)V波扼流圈和去耦電容連接到DRVDD。
• 使用單一的PCB接地平面，并合理進(jìn)行模擬、數(shù)字和時(shí)鐘部分的分區(qū)，同時(shí)將ADC底部的外露焊盤(pán)連接到模擬地，以實(shí)現(xiàn)最佳的電氣和熱性能。

總結(jié)

AD9626以其出色的性能、低功耗和豐富的集成功能，為電子工程師在設(shè)計(jì)高性能系統(tǒng)時(shí)提供了一個(gè)優(yōu)秀的選擇。在實(shí)際應(yīng)用中，工程師需要根據(jù)具體的需求，合理選擇輸入配置、時(shí)鐘源和電源方案，以充分發(fā)揮AD9626的優(yōu)勢(shì)。大家在使用AD9626的過(guò)程中，有沒(méi)有遇到過(guò)什么特別的問(wèn)題或者有什么獨(dú)特的設(shè)計(jì)經(jīng)驗(yàn)?zāi)?？歡迎在評(píng)論區(qū)分享交流。