高精度16位雙路DAC——AD5763的深度解析

在電子工程領(lǐng)域，數(shù)模轉(zhuǎn)換器（DAC）是連接數(shù)字世界和模擬世界的關(guān)鍵橋梁。今天，我們要深入探討一款高性能的雙路16位DAC——AD5763，它在工業(yè)自動(dòng)化、伺服控制、過(guò)程控制等眾多領(lǐng)域都有著廣泛的應(yīng)用。

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一、AD5763概述

AD5763是一款雙路16位串行輸入、雙極性電壓輸出的DAC，工作電源電壓范圍為±4.75 V至±5.25 V，標(biāo)稱滿量程輸出范圍為±4.096 V。它集成了輸出放大器、參考緩沖器和專有上電/掉電控制電路，還具備數(shù)字I/O端口，可通過(guò)串行接口進(jìn)行編程。

1.1 主要特性

• 高精度：最大積分非線性（INL）誤差和微分非線性（DNL）誤差均為±1 LSB，保證了輸出的準(zhǔn)確性。
• 低噪聲：噪聲僅為70 nV/√Hz，能有效減少信號(hào)干擾。
• 快速建立時(shí)間：最大建立時(shí)間為10 μs，可快速響應(yīng)輸入信號(hào)的變化。
• 可編程輸出范圍：提供±4.096 V、±4.201 V或±4.311 V三種輸出范圍選擇，滿足不同應(yīng)用需求。
• 集成功能豐富：集成參考緩沖器、片上裸片溫度傳感器，具備輸出控制、可編程短路保護(hù)等功能。
• 接口兼容性好：采用與DSP和微控制器兼容的串行接口，時(shí)鐘速率最高可達(dá)30 MHz。
• 寬溫度范圍：工作溫度范圍為?40°C至+105°C，適用于各種工業(yè)環(huán)境。

1.2 應(yīng)用領(lǐng)域

AD5763的高性能使其在多個(gè)領(lǐng)域得到廣泛應(yīng)用，包括工業(yè)自動(dòng)化、開環(huán)/閉環(huán)伺服控制、過(guò)程控制、數(shù)據(jù)采集系統(tǒng)、自動(dòng)測(cè)試設(shè)備、汽車測(cè)試與測(cè)量以及高精度儀器儀表等。

二、技術(shù)參數(shù)詳解

2.1 精度相關(guān)參數(shù)

• 分辨率：16位，能夠提供較高的輸出精度。
• 相對(duì)精度（INL）：最大誤差為±1 LSB，反映了DAC輸出與理想直線的最大偏差。
• 微分非線性（DNL）：最大誤差為±1 LSB，保證了DAC輸出的單調(diào)性。
• 雙極性零誤差：在25°C時(shí)，誤差范圍為?2 mV至+2 mV，溫度系數(shù)為±1 ppm FSR/°C。
• 零刻度誤差：在25°C時(shí)，誤差范圍為?2 mV至+2 mV，溫度系數(shù)為±1 ppm FSR/°C。
• 增益誤差：在25°C且粗增益寄存器為0時(shí)，誤差范圍為?0.03% FSR至+0.03% FSR，溫度系數(shù)為±1 ppm FSR/°C。

2.2 輸出特性參數(shù)

• 輸出電壓范圍：可通過(guò)粗增益寄存器進(jìn)行編程，有±4.096 V、±4.201 V、±4.311 V等多種選擇。
• 輸出電壓漂移：每500小時(shí)的漂移為±32 ppm FSR，每1000小時(shí)的漂移為±37 ppm FSR。
• 短路電流：可通過(guò)外部電阻進(jìn)行編程，范圍為500 μA至10 mA。
• 容性負(fù)載穩(wěn)定性：在不同負(fù)載電阻下，容性負(fù)載穩(wěn)定范圍不同，如RLOAD = ∞時(shí)為200 pF，RLOAD = 10 kΩ時(shí)為1000 pF。
• 直流輸出阻抗：僅為0.3 Ω，保證了輸出的穩(wěn)定性。

2.3 交流性能參數(shù)

• 輸出電壓建立時(shí)間：滿量程階躍至±1 LSB的建立時(shí)間最大為10 μs，512 LSB階躍的建立時(shí)間為2 μs。
• 壓擺率：為5 V/μs，反映了輸出電壓的變化速率。
• 數(shù)模毛刺能量：為20 nV - sec，毛刺脈沖峰值幅度為30 mV。
• 通道間隔離度：達(dá)到60 dB，有效減少通道間的干擾。
• DAC間串?dāng)_：為8 nV - sec，數(shù)字串?dāng)_為2 nV - sec。
• 輸出噪聲：在0.1 Hz至10 Hz范圍內(nèi)為0.1 nV - sec LSB p - p，在0.1 Hz至100 kHz范圍內(nèi)的1/f轉(zhuǎn)折頻率為50 - 300 μV rms，10 kHz處的輸出噪聲譜密度為70 nV/√Hz。

2.4 時(shí)序參數(shù)

AD5763的時(shí)序參數(shù)對(duì)于正確使用該器件至關(guān)重要，例如SCLK周期時(shí)間t1最小為33 ns，SCLK高電平時(shí)間t2和低電平時(shí)間t3最小均為13 ns等。這些參數(shù)確保了數(shù)據(jù)的正確傳輸和處理。

2.5 絕對(duì)最大額定值

在使用AD5763時(shí)，需要注意其絕對(duì)最大額定值，如電源電壓、輸入輸出電壓、工作溫度范圍等。超出這些額定值可能會(huì)導(dǎo)致器件永久性損壞，影響其可靠性。

三、工作原理

3.1 DAC架構(gòu)

AD5763采用16位電流模式分段R - 2R梯形DAC架構(gòu)。16位數(shù)據(jù)字的4個(gè)最高有效位（MSB）被解碼以驅(qū)動(dòng)15個(gè)開關(guān)，連接15個(gè)匹配電阻；其余12位驅(qū)動(dòng)12位R - 2R梯形網(wǎng)絡(luò)的開關(guān)。這種架構(gòu)能夠?qū)崿F(xiàn)高精度的數(shù)模轉(zhuǎn)換。

3.2 參考緩沖器

AD5763使用外部參考電壓，參考輸入范圍可達(dá)2.1 V。參考緩沖器將輸入電壓轉(zhuǎn)換為正、負(fù)參考電壓，為DAC核心提供穩(wěn)定的參考。正參考電壓VREFP = 2VREF，負(fù)參考電壓VREFN = - 2VREF，這些參考電壓與增益寄存器值共同決定了DAC的輸出范圍。

3.3 串行接口

AD5763通過(guò)3線串行接口進(jìn)行控制，時(shí)鐘速率最高可達(dá)30 MHz，兼容SPI、QSPI?、MICROWIRE?和DSP標(biāo)準(zhǔn)。輸入移位寄存器為24位，數(shù)據(jù)以24位字的形式按MSB優(yōu)先順序加載到器件中。

3.3.1 獨(dú)立操作

在獨(dú)立操作模式下，串行接口可使用連續(xù)或非連續(xù)串行時(shí)鐘。SYNC的第一個(gè)下降沿啟動(dòng)寫周期，必須施加24個(gè)下降時(shí)鐘沿到SCLK，然后SYNC拉高以鎖存數(shù)據(jù)。數(shù)據(jù)傳輸完成后，通過(guò)將LDAC拉低可更新所有DAC寄存器和輸出。

3.3.2 菊花鏈操作

對(duì)于包含多個(gè)器件的系統(tǒng)，可使用SDO引腳進(jìn)行菊花鏈連接。SYNC的第一個(gè)下降沿啟動(dòng)寫周期，SCLK在SYNC為低電平時(shí)持續(xù)施加。數(shù)據(jù)從移位寄存器移出并出現(xiàn)在SDO線上，通過(guò)連接多個(gè)器件的SDO和SDIN，可構(gòu)建多器件接口。

3.3.3 回讀操作

在回讀操作前，需通過(guò)寫入功能寄存器并清除SDO禁用位來(lái)啟用SDO引腳。設(shè)置R/W位為1可啟動(dòng)回讀模式，選擇要讀取的寄存器，后續(xù)SPI寫操作時(shí)，SDO輸出將包含所選寄存器的數(shù)據(jù)。

3.4 同時(shí)更新

根據(jù)SYNC和LDAC的狀態(tài)，DAC寄存器和輸出有兩種更新方式：

• 單個(gè)DAC更新：LDAC為低電平時(shí)，數(shù)據(jù)時(shí)鐘輸入到輸入移位寄存器，SYNC上升沿更新所尋址的DAC輸出。
• 所有DAC同時(shí)更新：LDAC為高電平時(shí)，數(shù)據(jù)時(shí)鐘輸入到輸入移位寄存器，SYNC拉高后，將LDAC拉低可同時(shí)更新所有DAC輸出。

3.5 異步清零（CLR）

CLR是負(fù)邊沿觸發(fā)的清零信號(hào)，可將輸出清零為0 V（二進(jìn)制補(bǔ)碼編碼）或負(fù)滿量程（偏移二進(jìn)制編碼）。CLR信號(hào)保持低電平的時(shí)間需滿足一定要求，信號(hào)返回高電平時(shí)，輸出保持清零值，直到寫入新值。也可通過(guò)軟件寫入命令0x04XXXX來(lái)啟動(dòng)清零操作。

3.6 功能寄存器

功能寄存器可通過(guò)設(shè)置三個(gè)REG位為000進(jìn)行尋址，其選項(xiàng)包括無(wú)操作（NOP）、本地接地偏移調(diào)整、D0/D1方向和值設(shè)置、SDO禁用、清零和加載等功能。

3.7 數(shù)據(jù)寄存器、增益寄存器和偏移寄存器

• 數(shù)據(jù)寄存器：通過(guò)設(shè)置三個(gè)REG位為010進(jìn)行尋址，DAC地址位選擇數(shù)據(jù)傳輸?shù)耐ǖ?，?shù)據(jù)位為16位。
• 粗增益寄存器：設(shè)置三個(gè)REG位為011進(jìn)行尋址，為2位寄存器，可選擇每個(gè)DAC的輸出范圍，如±4.096 V、±4.201 V或±4.311 V。
• 精細(xì)增益寄存器：設(shè)置三個(gè)REG位為100進(jìn)行尋址，為6位寄存器，可在?32 LSB至+31 LSB范圍內(nèi)以1 LSB為增量調(diào)整每個(gè)DAC通道的增益。
• 偏移寄存器：設(shè)置三個(gè)REG位為101進(jìn)行尋址，為8位寄存器，可在?16 LSB至+15.875 LSB范圍內(nèi)以? LSB為增量調(diào)整每個(gè)通道的偏移。

四、設(shè)計(jì)特點(diǎn)

4.1 模擬輸出控制

在工業(yè)過(guò)程控制應(yīng)用中，電源變化時(shí)，輸出引腳通過(guò)低阻抗路徑鉗位到0 V，同時(shí)打開傳輸門G1以防止輸出放大器短路。這些條件在電源穩(wěn)定且有效字寫入DAC寄存器后改變。RSTIN輸入可外部控制傳輸門，RSTOUT可用于控制其他系統(tǒng)部件。

4.2 數(shù)字偏移和增益控制

AD5763具備數(shù)字偏移調(diào)整功能，調(diào)整范圍為±16 LSB，分辨率為0.125 LSB。增益寄存器可調(diào)整滿量程輸出范圍，還提供精細(xì)增益微調(diào)功能。

4.3 可編程短路保護(hù)

通過(guò)在ISCC引腳和PGND之間插入外部電阻，可對(duì)輸出放大器的短路電流進(jìn)行編程，范圍為500 μA至10 mA。若ISCC引腳未連接，短路電流限制默認(rèn)為5 mA。需注意，過(guò)小的短路電流限制可能影響驅(qū)動(dòng)容性負(fù)載時(shí)的壓擺率。

4.4 數(shù)字I/O端口

AD5763包含一個(gè)2位數(shù)字I/O端口（D1和D0），可獨(dú)立配置為輸入或輸出，通過(guò)串行接口進(jìn)行驅(qū)動(dòng)和讀取。作為輸出時(shí)，可用于控制多路復(fù)用器或校準(zhǔn)電路；作為輸入時(shí)，可讀取限位開關(guān)的邏輯信號(hào)。

4.5 裸片溫度傳感器

片上裸片溫度傳感器提供與攝氏溫度線性成比例的電壓輸出，25°C時(shí)標(biāo)稱輸出電壓為1.44 V，溫度變化率為3 mV/°C，輸出范圍為1.175 V至1.9 V。其低輸出阻抗和線性輸出便于與溫度控制電路和ADC接口，主要用于指示裸片溫度變化以進(jìn)行重新校準(zhǔn)。

4.6 本地接地偏移調(diào)整

AD5763的本地接地偏移調(diào)整功能可在功能寄存器中啟用，用于調(diào)整DAC輸出，以補(bǔ)償單個(gè)DAC接地引腳與REFGND引腳之間的電壓差異，確保DAC輸出電壓始終相對(duì)于本地DAC接地引腳。

4.7 上電狀態(tài)

AD5763的多個(gè)電源和數(shù)字輸入引腳的上電順序很重要，輸出的上電狀態(tài)取決于BIN/2sCOMP、CLR和LDAC引腳的配置。不同配置下，輸出可能被鉗位到AGNDx、驅(qū)動(dòng)0 V或驅(qū)動(dòng)負(fù)滿量程輸出。

五、應(yīng)用信息

5.1 典型工作電路

AD5763的典型工作電路僅需一個(gè)參考電壓源、電源引腳和參考輸入上的去耦電容以及一個(gè)可選的短路電流設(shè)置電阻。由于器件集成了參考緩沖器，無(wú)需外部雙極性參考和相關(guān)緩沖器，節(jié)省了成本和電路板空間。

5.2 精密電壓參考選擇

為實(shí)現(xiàn)AD5763在全工作溫度范圍內(nèi)的最佳性能，需選擇精密電壓參考。選擇時(shí)需考慮初始精度、輸出電壓溫度系數(shù)、長(zhǎng)期漂移和輸出電壓噪聲等因素。推薦使用如ADR430和ADR420等精密參考器件。

5.3 布局指南

在設(shè)計(jì)印刷電路板（PCB）時(shí)，應(yīng)將模擬和數(shù)字部分分開，采用單點(diǎn)接地，確保AD5763有充足的電源旁路電容。電源線路應(yīng)使用盡可能大的走線，快速開關(guān)信號(hào)應(yīng)進(jìn)行屏蔽，避免與參考輸入靠近。同時(shí)，應(yīng)避免數(shù)字和模擬信號(hào)交叉，采用微帶技術(shù)可減少電路板上的串?dāng)_和噪聲。

5.4 電氣隔離接口

在許多過(guò)程控制應(yīng)用中，需要在控制器和被控單元之間提供隔離屏障，以保護(hù)控制電路免受危險(xiǎn)共模電壓的影響。AD5763的串行加載結(jié)構(gòu)使其適合隔離接口，可使用如ADuM1400等隔離器實(shí)現(xiàn)4通道隔離接口。

5.5 微處理器接口

AD5763通過(guò)串行總線與微處理器接口，采用與微控制器和DSP處理器兼容的標(biāo)準(zhǔn)協(xié)議。通信通道為3線最小接口，包括時(shí)鐘信號(hào)、數(shù)據(jù)信號(hào)和同步信號(hào)。DAC輸出更新可自動(dòng)完成或在LDAC控制下進(jìn)行，還可使用回讀功能讀取DAC寄存器的內(nèi)容。

六、總結(jié)

AD5763作為一款高性能的16位雙路DAC，憑借其高精度、低噪聲、快速建立時(shí)間等優(yōu)點(diǎn)，在工業(yè)自動(dòng)化等多個(gè)領(lǐng)域展現(xiàn)出強(qiáng)大的應(yīng)用潛力。通過(guò)深入了解其技術(shù)參數(shù)、工作原理和設(shè)計(jì)特點(diǎn)，電子工程師可以更好地利用這款器件，設(shè)計(jì)出滿足各種需求的高性能電路。在實(shí)際應(yīng)用中，合理選擇精密電壓參考、優(yōu)化PCB布局以及正確配置接口等，都將有助于充分發(fā)揮AD5763的性能優(yōu)勢(shì)。你在使用AD5763或其他DAC器件時(shí)遇到過(guò)哪些問(wèn)題呢？歡迎在評(píng)論區(qū)分享交流。