PCB設計之如何去耦
局部的高頻濾波器可以優(yōu)化小小效果，去耦電容可以減小回路電感
SOIC的去耦
經(jīng)驗法則
–Via resistance ≈ 1mΩ, Via inductance ≈1nH
LQFP/LFCSP去耦
不同的去耦電容阻抗VS頻率
并聯(lián)電容可以在一個較寬的頻帶內(nèi)降低阻抗
小的去耦電容盡可能靠近電源引腳
為什么每個電源引腳都需要去耦
去耦電容總結(jié)
旁路電容離電容引腳盡可能的近
SMT磁珠對于降低Ripple非常有效
高頻時需要地平面
最小化寄生參數(shù)
使用穩(wěn)定高效的器件
較少的漂移和較低的ESR
完全精確的分析是比較困難的
為了優(yōu)化結(jié)果可以使用一引起模型分析
使用一組并聯(lián)的電容來去除較寬頻帶內(nèi)的噪聲
聲明：本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點僅代表作者本人，不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學習之用，如有內(nèi)容侵權(quán)或者其他違規(guī)問題，請聯(lián)系本站處理。
舉報投訴
-
電容
+關(guān)注
關(guān)注
100文章
6479瀏覽量
159118 -
去耦電容
+關(guān)注
關(guān)注
12文章
325瀏覽量
23560
原文標題：優(yōu)秀PCB設計之去耦
文章出處：【微信號：QCDZYJ，微信公眾號：汽車電子工程知識體系】歡迎添加關(guān)注！文章轉(zhuǎn)載請注明出處。
發(fā)布評論請先 登錄
相關(guān)推薦
熱點推薦
詳解去耦電容：去耦電容的PCB布局布線
從電源上看，沒有去耦電容的時候如左側(cè)的波形，加上了去耦電容之后變成了右側(cè)的樣子，供電電壓的波形變得干凈了，我們稱該電容的作用是去掉了耦和在干
PCB設計之電容
1.PCB設計之電容的結(jié)構(gòu)和特性給導體加電位，導體就帶上電荷。但對于相同的電位，導體容納電荷的數(shù)量卻因它本身結(jié)構(gòu)的不同而不同。導體能夠容納電荷的能力稱為PCB設計之電容。 通常，某導體
發(fā)表于 08-13 10:49
高速PCB電源去耦設計指南
工程師們在設計PCB電源分配系統(tǒng)的時候，首先把整個設計分成四個部分：電源(電池、轉(zhuǎn)換器或者整流器)、PCB、電路板去耦電容和芯片去
發(fā)表于 10-16 12:49
?926次閱讀
優(yōu)秀的高速PCB設計之去耦電容
需要考慮工作頻率，I/O的開關(guān)數(shù)量，每個Pin腳的容性負載，走線的特征阻抗， 結(jié)點的溫度，芯片內(nèi)部的運算。
PCB設計時處理去耦電容和旁路電容的注意事項
本篇介紹PCB設計時處理去耦電容和旁路電容的注意事項。
去耦電容（另見退耦電容、緩沖電容、儲能電容等），可以放置在電源電路公共出口
工商網(wǎng)監(jiān)
評論