數(shù)字設(shè)計FPGA應(yīng)用：阻塞與非阻塞
阻塞賦值即賦值沒完成，后邊的語句將無法執(zhí)行，非阻塞剛好與其相反，即賦值完不完成并不阻礙后續(xù)程序的執(zhí)行，所以我們常說非阻塞賦值的對象并未立馬得到新值，如果從時序來看，被賦值對象會比賦值對象差一個時鐘周期。
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