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The HSP43481 is a video-speed Digital Filter (DF) designed
to efficiently implement vector operations such as FIR digital
filters. It is comprised of four filter cells cascaded internally
and a shift-and-add output stage, all in a single integrated
circuit. Each filter cell contains an 8 x 8 multiplier, three decimation
registers and a 26-bit accumulator which can add
the contents of any filter cell accumulator to the output stage
accumulator shifted right by eight-bits. The HSP43481 has a
maximum sample rate of 30MHz. The effective multiplyaccumulate
(MAC) rate is 120MHz.
to efficiently implement vector operations such as FIR digital
filters. It is comprised of four filter cells cascaded internally
and a shift-and-add output stage, all in a single integrated
circuit. Each filter cell contains an 8 x 8 multiplier, three decimation
registers and a 26-bit accumulator which can add
the contents of any filter cell accumulator to the output stage
accumulator shifted right by eight-bits. The HSP43481 has a
maximum sample rate of 30MHz. The effective multiplyaccumulate
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HS
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