資料介紹
為了在提高數(shù)據(jù)采集卡的速度的同時降低成本,設計了一種應用流水線存儲技術的數(shù)據(jù)采集系統(tǒng)。該系統(tǒng)應用軟件與硬件相結(jié)合的方式來控制實現(xiàn),通過MAX1308模數(shù)轉(zhuǎn)換器完成ADC的轉(zhuǎn)化過程,采用多片Nandflmh流水線數(shù)據(jù)存儲模式對高速采集的數(shù)據(jù)進行存儲。搭建硬件電路,并在FPGA內(nèi)部通過編寫VHDL語言實現(xiàn)了采集模塊、控制與存儲模塊和Nandflmh存儲功能。調(diào)試結(jié)果表明,芯片的讀寫時序信號對應的位置準確無誤,沒有出現(xiàn)時序混亂,且采集速度能保持在10 Mb/s以上。系統(tǒng)實現(xiàn)了低成本、高速多路采集的設計要求。

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