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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>LVDS和CML與LVPECL的不同邏輯電平之間的互連教程

      LVDS和CML與LVPECL的不同邏輯電平之間的互連教程

      2021-01-07 | rar | 1.08 MB | 次下載 | 免費(fèi)

      資料介紹

      　　1、LVPECL的互連

      　　1.1、LVPECL到CML的連接

      　　一般情況下，兩種不同直流電平的信號(hào)（即輸出信號(hào)的直流電平與輸入需求的直流電平相差比較大），比較提倡使用AC耦合，這樣輸出的直流電平與輸入的直流電平獨(dú)立。

      　　1.1.1、直流匹配

      　　在LVPECL到CML的直流耦合連接方式中需要一個(gè)電平轉(zhuǎn)換網(wǎng)絡(luò)。該電平轉(zhuǎn)換網(wǎng)絡(luò)的作用是匹配LVPECL的輸出與CML的輸入共模電壓。一般要求該電平轉(zhuǎn)換網(wǎng)絡(luò)引入的損耗要小，以保證LVPECL的輸出經(jīng)過衰減后仍能滿足CML輸入靈敏度的要求；另外還要求從LVPECL端看到的負(fù)載阻抗近似為50Ω。

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