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摘要：介紹了為PET（正電子發(fā)射斷層掃描儀）的前端電子學(xué)模塊提供時(shí)間基準(zhǔn)而設(shè)計(jì)的一種新型高頻時(shí)鐘扇出電路。該電路利用FPGA芯片來(lái)實(shí)現(xiàn)對(duì)高頻時(shí)鐘的分頻與分配，并用LVDS傳輸標(biāo)準(zhǔn)對(duì)生成的多路時(shí)鐘信號(hào)進(jìn)行傳輸，從而最大程度地減少了輸出各路時(shí)鐘之間的延時(shí)偏差，同時(shí)利用低壓差分信號(hào)的傳輸特性增強(qiáng)了信號(hào)的抗干擾能力。文章給出了采用VHDL語(yǔ)言編寫的時(shí)鐘電路程序代碼。
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