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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>利用FPGA的高頻時鐘扇出電路的分頻和分配設(shè)計

      利用FPGA的高頻時鐘扇出電路的分頻和分配設(shè)計

      2023-08-16 | rar | 0.15 MB | 次下載 | 免費

      資料介紹

      摘要：介紹了為PET（正電子發(fā)射斷層掃描儀）的前端電子學(xué)模塊提供時間基準而設(shè)計的一種新型高頻時鐘扇出電路。該電路利用FPGA芯片來實現(xiàn)對高頻時鐘的分頻與分配，并用LVDS傳輸標準對生成的多路時鐘信號進行傳輸，從而最大程度地減少了輸出各路時鐘之間的延時偏差，同時利用低壓差分信號的傳輸特性增強了信號的抗干擾能力。文章給出了采用VHDL語言編寫的時鐘電路程序代碼。

      FPGA 時鐘 vhdl 分頻
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