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      電子發(fā)燒友網(wǎng)>電子資料下載>模擬數(shù)字>基于AD9850的倍頻器設(shè)計(jì)

      基于AD9850的倍頻器設(shè)計(jì)

      2010-12-11 | rar | 1534 | 次下載 | 10積分

      資料介紹

      介紹基于直接數(shù)字頻率合成器（DDS）AD9850的倍頻器設(shè)計(jì)，倍頻倍數(shù)N可以在限定范圍內(nèi)自行設(shè)置。系統(tǒng)主要模塊CPLD/FPGA、DDS（AD9850）和單片機(jī)(80C51)之間可以并行通信，具有編程控制簡(jiǎn)便、接口簡(jiǎn)單、成本低、易于實(shí)現(xiàn)系統(tǒng)小型化等優(yōu)點(diǎn)。在定時(shí)、算法精確的前提下，倍頻后的波形平均精度達(dá)到10-3。
      Abstract:
      ?The design of frequency multiplier based on AD9850 which is a kind of? DDS’s chip is introduced in this paper，and the frequency multiplier coefficient N can be set in one limited scope. The three major modules—CPLD/FPGA, AD9850 and 80C51 work in the parallel ways.The system has a lot of? advantages—it’s easy to be controlled, and it’s easy to be connected, and it has low cost, and it’s easy to realize the small system,and so on.The average accuracy of the output wave can reach 10-3 when the timer and the arithmetic are accurate.
      AD9850 倍頻器
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