資料介紹
介紹了一種基于四相關器結構的2.5gb/s 15 mW時鐘恢復電路的設計。該電路采用鑒相和鑒頻相結合的方法,將微分、全波整流、混頻等高速運算結合在一起,降低了功耗。此外,采用兩級壓控振蕩器,該振蕩器包含兩個相移元件,以提供寬調諧范圍和隔離技術,以抑制由于輸入數(shù)據轉換而產生的饋通。該電路采用20ghz 1-?m BiCMOS技術制作,其均方根抖動為9.5ps,捕獲范圍為300mhz。

速低功耗時鐘恢復電路在高性能通信系統(tǒng)中有著廣泛的應用,本文介紹了一種采用20ghz 1-m BiCMOS技術制作的2.5gb/s 15 mW時鐘恢復電路(CRC)的設計。該電路采用改進的“四相關器”結構、利用相位和頻率檢測從非歸零(NRZ)數(shù)據序列中提取時鐘。除了低功耗外,一個重要的問題是獲得相對較寬的捕獲范圍,以便在溫度和過程變化時電路能夠鎖定輸入。時鐘恢復電路被設計用于以2.5 Gb/s(SONET OC-48標準)運行的光纖接收器的前端。雖然目前以該速率實現(xiàn)的主要是III-V技術,但在主流VLSI工藝中執(zhí)行該功能是有利的,以便允許更高級別的整合。圖1所示為典型的光纖前端的框圖,其中NRZ數(shù)據以光的形式被接收并由光電探測器轉換為電流。然后電流被放大并通過跨阻放大器轉換成電壓,因為進一步的數(shù)字處理需要數(shù)據的定時信息,時鐘恢復電路提取時鐘,判決電路對數(shù)據進行重定時。因此,可以同步執(zhí)行以下數(shù)據處理。
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