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      電子發(fā)燒友網(wǎng)>電子資料下載>嵌入式開發(fā)>虛擬嵌入式設(shè)計測試環(huán)境下STM32控制器的軟件仿真

      虛擬嵌入式設(shè)計測試環(huán)境下STM32控制器的軟件仿真

      2021-11-03 | pdf | 217.18KB | 次下載 | 3積分

      資料介紹

      將仿真硬件集成到嵌入式測試環(huán)境中并在嵌入式軟件開發(fā)生命周期（EDLC）的初始階段對嵌入式軟件（ESW）進(jìn)行轉(zhuǎn)換和替換測試。仿真技術(shù)消除了對硬件的替代，在硬件仿真已經(jīng)在工業(yè)中使用Verilog和像HILO這樣的硬件設(shè)計模擬器來測試硬件設(shè)計。在制造硬件芯片之前進(jìn)行的大量硬件設(shè)計測試被證明是具有成本效益的，并且可以節(jié)省硬件設(shè)計和開發(fā)的工作量。以及，嵌入式設(shè)備的軟件仿真取得了一些進(jìn)展，為嵌入式SDLC鋪平了道路。本文針對嵌入式系統(tǒng)測試，對現(xiàn)有的驗(yàn)證技術(shù)及其存在的不足進(jìn)行了詳細(xì)的研究。在此基礎(chǔ)上，由Fa...
      嵌入式設(shè)計
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