資料介紹
54/74164
8 位移位寄存器(串行輸入,并行輸出)
簡要說明
164 為 8 位移位寄存器,其主要電特性的典型值如下:
型號 fm Pn
54/74164 36MHz 185mW
54/74LS164 36 MHz 80mW
當清除端(CLEAR)為低電平時,輸出端(QA-QH)均為低電平。
串行數(shù)據(jù)輸入端(A,B)可控制數(shù)據(jù)。當 A、B 任意一個為低電平,則禁
止新數(shù)據(jù)輸入,在時鐘端(CLOCK)脈沖上升沿作用下 Q0 為低電平。當 A、B
有一個為高電平,則另一個就允許輸入數(shù)據(jù),并在 CLOCK 上升沿作用下決定
Q0 的狀態(tài)。
引出端符號
CLOCK 時鐘輸入端
CLEAR 同步清除輸入端(低電平有效)A,B 串行數(shù)據(jù)輸入端
QA-QH 輸出端
邏輯及封裝圖
8 位移位寄存器(串行輸入,并行輸出)
簡要說明
164 為 8 位移位寄存器,其主要電特性的典型值如下:
型號 fm Pn
54/74164 36MHz 185mW
54/74LS164 36 MHz 80mW
當清除端(CLEAR)為低電平時,輸出端(QA-QH)均為低電平。
串行數(shù)據(jù)輸入端(A,B)可控制數(shù)據(jù)。當 A、B 任意一個為低電平,則禁
止新數(shù)據(jù)輸入,在時鐘端(CLOCK)脈沖上升沿作用下 Q0 為低電平。當 A、B
有一個為高電平,則另一個就允許輸入數(shù)據(jù),并在 CLOCK 上升沿作用下決定
Q0 的狀態(tài)。
引出端符號
CLOCK 時鐘輸入端
CLEAR 同步清除輸入端(低電平有效)A,B 串行數(shù)據(jù)輸入端
QA-QH 輸出端
邏輯及封裝圖
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