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SN65LVDS93A LVDS SerDes（串行器/解串器）發(fā)送器在單個(gè)集成電路中包含 4 個(gè) 7 位并行負(fù)載串行輸出 移位寄存器、1 個(gè) 7 時(shí)鐘合成器以及 5 個(gè)低電壓差動(dòng) 信號(hào) (LVDS) 驅(qū)動(dòng)器。借助這些功能，可以通過(guò) 5 個(gè) 平衡對(duì)導(dǎo)體同步傳輸 28 位單端 LVTTL 數(shù)據(jù)并由兼容 的接收器（如 SN65LVDS94）進(jìn)行接收。 發(fā)送數(shù)據(jù)時(shí)，數(shù)據(jù)位 D0 至 D27 會(huì)在輸入時(shí)鐘信號(hào) (CLKIN) 邊沿全部加載到寄存器中?？赏ㄟ^(guò)時(shí)鐘選擇 (CLKSEL) 引腳來(lái)選擇時(shí)鐘的上升沿或下降沿。CLKIN 的頻率會(huì)實(shí)現(xiàn)比率為 7 的倍增，然后用于以串行方式 以 7 位時(shí)間片解除數(shù)據(jù)寄存器的負(fù)載。接著會(huì)將 4 個(gè) 串行數(shù)據(jù)流和鎖相時(shí)鐘 (CLKOUT) 輸出至 LVDS 輸出 驅(qū)動(dòng)器。CLKOUT 的頻率與輸入時(shí)鐘 (CLKIN) 相同。
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