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      封裝與高速技術(shù)前沿

      文章：37 被閱讀：13.2w 粉絲數(shù)：14 關(guān)注數(shù)：0 點(diǎn)贊數(shù)：3

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      DDR training的產(chǎn)生原因

      信號(hào)完整性(Signal Integrity, SI)問題：隨著DDR內(nèi)存頻率的提高，信號(hào)完整性問題....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 11-17 10:25 ?4297次閱讀
      DDR training的產(chǎn)生原因

      簡單認(rèn)識(shí)eSchema電路設(shè)計(jì)工具

      eSchema電路設(shè)計(jì)工具作為一款面向?qū)I(yè)IC設(shè)計(jì)者的綜合解決方案，通過集成原理圖設(shè)計(jì)、電氣規(guī)則檢查....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 11-17 10:22 ?746次閱讀
      簡單認(rèn)識(shí)eSchema電路設(shè)計(jì)工具

      UniVistaEDMPro電子設(shè)計(jì)自動(dòng)化檢查與評(píng)審解決方案

      UniVista EDMPro是一款融合電子系統(tǒng)研制流程、技術(shù)與管理實(shí)踐的差異化一站式電子設(shè)計(jì)數(shù)據(jù)管....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 10-29 11:11 ?1125次閱讀
      UniVistaEDMPro電子設(shè)計(jì)自動(dòng)化檢查與評(píng)審解決方案

      淺談DDR的邏輯電平標(biāo)準(zhǔn)

      總所周知，一般我們?cè)趯?duì)通信芯片互連的時(shí)候，要求兩者的IO接口電平標(biāo)準(zhǔn)是一樣的，而在學(xué)習(xí)FPGA與DD....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 10-29 11:09 ?3651次閱讀
      淺談DDR的邏輯電平標(biāo)準(zhǔn)

      DDR器件管腳說明

      DDR是硬件設(shè)計(jì)的重要一環(huán)，作為一名硬件工程師除了對(duì)DDR基礎(chǔ)和原理要有了解外，最重要的也就是對(duì)DD....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 10-10 09:15 ?3336次閱讀
      DDR器件管腳說明

      Wisim DC電源完整性EDA物理驗(yàn)證仿真工具介紹

      Wisim DC是一款高效、高性能的平臺(tái)級(jí)電源完整性EDA物理驗(yàn)證仿真工具?？煽焖僭\斷IC封裝和系統(tǒng)....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 09-26 15:57 ?740次閱讀
      Wisim DC電源完整性EDA物理驗(yàn)證仿真工具介紹

      Wisim SI頻域SI仿真軟件的核心特點(diǎn)及應(yīng)用優(yōu)勢(shì)

      Wisim SI是一款高效、精準(zhǔn)的頻域信號(hào)完整性物理驗(yàn)證EDA仿真工具。能夠高效準(zhǔn)確地為設(shè)計(jì)人員提取....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 09-11 11:42 ?1203次閱讀
      Wisim SI頻域SI仿真軟件的核心特點(diǎn)及應(yīng)用優(yōu)勢(shì)

      DDR4堆疊模組的熱仿真案例分析

      在電子設(shè)備的散熱設(shè)計(jì)中，熱阻（Thermal Resistance）是一個(gè)至關(guān)重要的物理量，它定量描....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 08-18 11:10 ?3625次閱讀
      DDR4堆疊模組的熱仿真案例分析

      上海圖元軟件國產(chǎn)高端PCB設(shè)計(jì)解決方案

      在當(dāng)今快速發(fā)展的電子行業(yè)中，高效、精確的PCB（印刷電路板）設(shè)計(jì)工具是確保產(chǎn)品競爭力的關(guān)鍵。為滿足市....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 08-08 11:12 ?4469次閱讀
      上海圖元軟件國產(chǎn)高端PCB設(shè)計(jì)解決方案

      Allegro Package Designer Plus中設(shè)置Degassing向?qū)?/a>

      ? Cadence Allegro Package Designer Plus提供了一個(gè)完整的原理圖....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 11-21 10:57 ?2470次閱讀
      Allegro Package Designer Plus中設(shè)置Degassing向?qū)? /> </a> </div><div id=

      利用SIP Layout工具構(gòu)建PoP封裝結(jié)構(gòu)的方法

      ? PoP封裝結(jié)構(gòu) 將要?jiǎng)?chuàng)建的元件參數(shù)如下： 1、共有3顆die，上面封裝基板正面放置2顆， Wir....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 11-12 10:39 ?1841次閱讀
      利用SIP Layout工具構(gòu)建PoP封裝結(jié)構(gòu)的方法

      如何使用SIP Layout建立PiP封裝結(jié)構(gòu)

      ? PiP封裝結(jié)構(gòu) 將要?jiǎng)?chuàng)建的元件參數(shù)如下： 1、共有2顆die，上方的封裝基板正面放置1顆，Wir....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 11-09 10:58 ?1233次閱讀
      如何使用SIP Layout建立PiP封裝結(jié)構(gòu)

      什么是高密度DDR芯片

      高密度DDR(Double Data Rate)芯片是一種先進(jìn)的動(dòng)態(tài)隨機(jī)存取存儲(chǔ)器(DRAM)芯片，....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 11-05 11:05 ?2038次閱讀

      異構(gòu)集成封裝類型詳解

      隨著摩爾定律的放緩，半導(dǎo)體行業(yè)越來越多地采用芯片設(shè)計(jì)和異構(gòu)集成封裝來繼續(xù)推動(dòng)性能的提高。這種方法是將....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 11-05 11:00 ?2774次閱讀
      異構(gòu)集成封裝類型詳解

      堆疊封裝技術(shù)的類型解析

      DDR作為一種內(nèi)存技術(shù)正朝著更高性能、更低功耗的方向發(fā)展。應(yīng)用前景廣闊，將對(duì)半導(dǎo)體、計(jì)算機(jī)、汽車、新....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 11-05 10:56 ?2616次閱讀
      堆疊封裝技術(shù)的類型解析

      半導(dǎo)體封裝材料之鍵合線

      微電子鍵合線有多種純材料和合金材料。除了圓線外，扁帶材料還可用于射頻和微波電路等特殊應(yīng)用中。圓線是迄....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 10-27 16:37 ?5692次閱讀
      半導(dǎo)體封裝材料之鍵合線

      淺談?dòng)⑻貭栐谙冗M(jìn)封裝領(lǐng)域的探索

      隨著工藝節(jié)點(diǎn)的進(jìn)步，英特爾也在不斷推進(jìn)下一代封裝技術(shù)的發(fā)展。對(duì)高性能硅需求與工藝節(jié)點(diǎn)開發(fā)相結(jié)合，創(chuàng)造....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 10-09 15:32 ?1757次閱讀
      淺談?dòng)⑻貭栐谙冗M(jìn)封裝領(lǐng)域的探索

      芯片封裝技術(shù)中不同術(shù)語的基本定義

      在現(xiàn)代芯片封裝技術(shù)中，"bump" 和 “micro bump” 是用于不同封裝類型的關(guān)鍵組件，尤其....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 10-09 15:29 ?5975次閱讀

      Orcad中怎么批量修改屬性值字體的大小

      OrCAD Capture是一款具有簡單易用、功能特點(diǎn)豐富的電路原理圖輸入工具。由于它簡單直觀的使用....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 10-09 15:24 ?4330次閱讀
      Orcad中怎么批量修改屬性值字體的大小

      用Assign Color快速區(qū)分不同網(wǎng)絡(luò)

      步驟一：打開一個(gè) PCB 文件，如下圖 1 所示。
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 10-09 15:17 ?1606次閱讀
      用Assign Color快速區(qū)分不同網(wǎng)絡(luò)

      如何提升Pspice仿真速度

      OrCAD PSpice A/D和高級(jí)分析技術(shù)（A/A）結(jié)合了業(yè)界先進(jìn)的模擬、模數(shù)混合信號(hào)以及分析工....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 10-09 15:15 ?3722次閱讀
      如何提升Pspice仿真速度

      一句話概括DDR、LPDDR、GDDR的區(qū)別

      以DDR開頭的內(nèi)存適用于計(jì)算機(jī)、服務(wù)器和其他高性能計(jì)算設(shè)備等領(lǐng)域，目前應(yīng)用廣泛的是DDR3和DDR4....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 05-10 14:21 ?14888次閱讀
      一句話概括DDR、LPDDR、GDDR的區(qū)別

      orcad capture修改元件庫后如何更新原理圖

      OrCAD Capture是一款具有簡單易用、功能特點(diǎn)豐富的電路原理圖輸入工具。
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 05-10 14:19 ?5325次閱讀

      DSN設(shè)計(jì)差異深度技術(shù)指南與解析

      DSN是當(dāng)前已經(jīng)打開原理圖文件； 02.DSN是需要對(duì)比的文件； Design Differene對(duì)....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 04-27 11:06 ?2881次閱讀
      DSN設(shè)計(jì)差異深度技術(shù)指南與解析

      Allegro中元器件位號(hào)重排并反標(biāo)回原理圖

      因?yàn)槲惶?hào)重排是按照位置來的，所以應(yīng)在所有元器件位號(hào)絲印全部排列好后再進(jìn)行重排，推薦在出光繪之前進(jìn)行重....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 04-26 14:11 ?10953次閱讀
      Allegro中元器件位號(hào)重排并反標(biāo)回原理圖

      Orcad CIS功能下原理圖Part參數(shù)更新指南

      原理圖Part參數(shù)是指在設(shè)計(jì)電路時(shí)，對(duì)于每個(gè)元件所需填寫的相關(guān)信息，如元件名稱、型號(hào)、封裝等。這些參....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 04-03 12:50 ?2834次閱讀
      Orcad CIS功能下原理圖Part參數(shù)更新指南

      卓越性能與微型化技術(shù)的完美融合—高密度DDR4芯片

      在現(xiàn)代電子系統(tǒng)的核心組件中，內(nèi)存的性能與穩(wěn)定性至關(guān)重要。高密度DDR4芯片作為當(dāng)前內(nèi)存技術(shù)的杰出代表....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 03-22 14:47 ?1604次閱讀
      卓越性能與微型化技術(shù)的完美融合—高密度DDR4芯片

      Chiplet封裝用有機(jī)基板的信號(hào)完整性設(shè)計(jì)

      摩爾定律在設(shè)計(jì)、制造、封裝3個(gè)維度上推動(dòng)著集成電路行業(yè)發(fā)展。
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 03-15 14:48 ?4905次閱讀
      Chiplet封裝用有機(jī)基板的信號(hào)完整性設(shè)計(jì)

      RDL線寬線距將破亞微米賦能扇出封裝高效能低成本集成

      RDL 技術(shù)是先進(jìn)封裝異質(zhì)集成的基礎(chǔ)，廣泛應(yīng)用扇出封裝、扇出基板上芯片、扇出層疊封裝、硅光子學(xué)和 2....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 03-01 13:59 ?7852次閱讀
      RDL線寬線距將破亞微米賦能扇出封裝高效能低成本集成

      淺析AWR微波仿真的優(yōu)勢(shì)

      ADS：由Keysight Technologies（前身為Agilent Technologies....
      的頭像 封裝與高速技術(shù)前沿 發(fā)表于 09-07 11:49 ?4849次閱讀
      淺析AWR微波仿真的優(yōu)勢(shì)