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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>Xilinx 7系列中SERDES的應用概述

      Xilinx 7系列中SERDES的應用概述

      2020-12-31 | rar | 0.04 MB | 次下載 | 免費

      資料介紹

      　　SERDES是英文SERializer（串行器）/DESerializer（解串器）的簡稱。它是一種主流的時分多路復用（TDM）、點對點（P2P）的串行通信技術。即在發(fā)送端多路低速并行信號被轉(zhuǎn)換成高速串行信號，經(jīng)過傳輸媒體（光纜或銅線），最后在接收端高速串行信號重新轉(zhuǎn)換成低速并行信號。這種點對點的串行通信技術充分利用傳輸媒體的信道容量，減少所需的傳輸信道和器件引腳數(shù)目，提升信號的傳輸速度，從而大大降低通信成本。xilinx 7系列通過原語調(diào)用serdes接口，就可以實現(xiàn)串并（并串）轉(zhuǎn)化的應用。

      　　平臺：AT7 Xilinx USB3.0+LVDS+FPGA開發(fā)板

      　　語言：SystemVerilog

      　　功能：20M時鐘產(chǎn)生8位的數(shù)據(jù)經(jīng)serdes串化，由一對LVDS輸出，再由另一對LVDS接收，經(jīng)serdes解串恢復8bit的數(shù)據(jù)。

      　　這里，在特權的LVDS測試例程上簡化，只用調(diào)用原語serdes驗證數(shù)據(jù)的傳輸（說實話，特權同學的例程代碼，確實有點凌亂，前后看了兩天?？赡苁菍@些其中用到的原語不熟吧）
      ?

      FPGA Xilinx 串行通信
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