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FPGA技術(shù)江湖

文章:269 被閱讀:101.7w 粉絲數(shù):78 關(guān)注數(shù):0 點贊數(shù):26

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使用TinyFPGA-Bootloader將比特流加載到FPGA

在 FPGA 設(shè)計中,一個常見但略顯繁瑣的環(huán)節(jié)是:如何方便地將新的比特流加載到 FPGA。尤其是在沒....
的頭像 FPGA技術(shù)江湖 發(fā)表于 12-19 15:20 ?5146次閱讀
使用TinyFPGA-Bootloader將比特流加載到FPGA

FPGA仿真如何極致壓榨CPU性能

對于許多FPGA/IC工程師而言,設(shè)計實現(xiàn)游刃有余,驗證仿真卻常成短板——傳統(tǒng)驗證方法面臨兩難困局:....
的頭像 FPGA技術(shù)江湖 發(fā)表于 12-19 15:18 ?4835次閱讀
FPGA仿真如何極致壓榨CPU性能

基于FPGA的音頻預(yù)加重濾波器設(shè)計

在語音信號中,聲門波激勵和口鼻輻射效應(yīng)共同導(dǎo)致語音信號的高頻分量能量要比低頻分量弱。
的頭像 FPGA技術(shù)江湖 發(fā)表于 12-19 15:13 ?7545次閱讀
基于FPGA的音頻預(yù)加重濾波器設(shè)計

使用Xilinx 7系列FPGA的四位乘法器設(shè)計

隨著 IoT、邊緣計算等應(yīng)用對低位寬、高并行、高效率算術(shù)運算的需求攀升,基礎(chǔ)算術(shù)電路,如 4 位乘法....
的頭像 FPGA技術(shù)江湖 發(fā)表于 11-17 09:49 ?3620次閱讀
使用Xilinx 7系列FPGA的四位乘法器設(shè)計

FPGA+DSP/ARM架構(gòu)開發(fā)與應(yīng)用

自中高端FPGA技術(shù)成熟以來,F(xiàn)PGA+DSP/ARM架構(gòu)的硬件設(shè)計在眾多工業(yè)領(lǐng)域得到廣泛應(yīng)用。例如....
的頭像 FPGA技術(shù)江湖 發(fā)表于 10-15 10:39 ?4498次閱讀
FPGA+DSP/ARM架構(gòu)開發(fā)與應(yīng)用

ZYNQ PS與PL數(shù)據(jù)交互方式

ZYNQ SoC 的 PS (Processing System) 和 PL (Programmab....
的頭像 FPGA技術(shù)江湖 發(fā)表于 10-15 10:33 ?1300次閱讀
ZYNQ PS與PL數(shù)據(jù)交互方式

AD9528雙級PLL的時鐘分布特性

AD9528是一款雙級PLL,集成JESD204B SYSREF發(fā)生器,可用于多器件同步。
的頭像 FPGA技術(shù)江湖 發(fā)表于 10-15 10:24 ?1666次閱讀
AD9528雙級PLL的時鐘分布特性

PCIe 7.0技術(shù)細(xì)節(jié)曝光

6 月 11 日 PCI SIG官宣 PCI Express 7.0(PCIe 7.0)規(guī)范最終版已....
的頭像 FPGA技術(shù)江湖 發(fā)表于 09-08 10:43 ?3058次閱讀
PCIe 7.0技術(shù)細(xì)節(jié)曝光

Pico2-ICE FPGA開發(fā)板的應(yīng)用示例

FPGA 和 MCU 結(jié)合的開發(fā)板不多,而 Pico2?ICE 則把小巧、靈活和易上手完美結(jié)合。搭載....
的頭像 FPGA技術(shù)江湖 發(fā)表于 09-06 10:02 ?1282次閱讀
Pico2-ICE FPGA開發(fā)板的應(yīng)用示例

雷達系統(tǒng)中數(shù)字下變頻的實現(xiàn)

本次設(shè)計同樣是通過在simulink搭建模型并通過matlab仿真得到正確設(shè)計后生成IP核的形式來實....
的頭像 FPGA技術(shù)江湖 發(fā)表于 08-30 14:29 ?1537次閱讀
雷達系統(tǒng)中數(shù)字下變頻的實現(xiàn)

vivado仿真時GSR信號的影響

利用vivado進行設(shè)計xilinx FPGA時,寫完設(shè)計代碼和仿真代碼后,點擊run simula....
的頭像 FPGA技術(shù)江湖 發(fā)表于 08-30 14:22 ?1540次閱讀
vivado仿真時GSR信號的影響

使用Verilog在FPGA上實現(xiàn)FOC電機控制系統(tǒng)

在自動駕駛、電動滑板車、無人機甚至工業(yè)自動化領(lǐng)域,高性能電機控制是不可或缺的核心技術(shù)。而如果你對硬件....
的頭像 FPGA技術(shù)江湖 發(fā)表于 08-21 15:27 ?5557次閱讀
使用Verilog在FPGA上實現(xiàn)FOC電機控制系統(tǒng)

基于FPGA和USB3.0通信的UVC攝像機設(shè)計方案

本次演示用的是USB3.0芯片-CYPRESS CYUSB3014(下稱 FX3),該芯片是標(biāo)準(zhǔn)的U....
的頭像 FPGA技術(shù)江湖 發(fā)表于 07-21 16:20 ?7333次閱讀
基于FPGA和USB3.0通信的UVC攝像機設(shè)計方案

基于FPGA的數(shù)字識別系統(tǒng)設(shè)計

在圖像處理領(lǐng)域,圖像識別是較為困難而關(guān)鍵的技術(shù)。這項技術(shù)被廣泛的應(yīng)用到娛樂、工業(yè)、軍事等領(lǐng)域。本次設(shè)....
的頭像 FPGA技術(shù)江湖 發(fā)表于 07-16 14:28 ?1869次閱讀
基于FPGA的數(shù)字識別系統(tǒng)設(shè)計

基于FPGA YOLO算法的掃描式SMT焊點缺陷檢測系統(tǒng)設(shè)計

作為電子產(chǎn)品最重要的組成部分,印刷電路板(PCB)的設(shè)計日趨復(fù)雜和器件尺寸的縮小,促使對 SMT 可....
的頭像 FPGA技術(shù)江湖 發(fā)表于 07-16 11:16 ?3717次閱讀
基于FPGA YOLO算法的掃描式SMT焊點缺陷檢測系統(tǒng)設(shè)計

基于Matlab與FPGA的雙邊濾波算法實現(xiàn)

前面發(fā)過中值、均值、高斯濾波的文章,這些只考慮了位置,并沒有考慮相似度。那么雙邊濾波來了,既考慮了位....
的頭像 FPGA技術(shù)江湖 發(fā)表于 07-10 11:28 ?4783次閱讀
基于Matlab與FPGA的雙邊濾波算法實現(xiàn)

基于FPGA LMS算法的自適應(yīng)濾波器設(shè)計

自適應(yīng)濾波是近幾十年發(fā)展起來的信號處理理論的的新分支。隨著人們在該領(lǐng)域研究的不斷深入,自適應(yīng)處理的理....
的頭像 FPGA技術(shù)江湖 發(fā)表于 07-10 11:25 ?3621次閱讀
基于FPGA LMS算法的自適應(yīng)濾波器設(shè)計

基于FPGA的SSD目標(biāo)檢測算法設(shè)計

隨著人工智能的發(fā)展,神經(jīng)網(wǎng)絡(luò)正被逐步應(yīng)用于智能安防、自動駕駛、醫(yī)療等各行各業(yè)。目標(biāo)識別作為人工智能的....
的頭像 FPGA技術(shù)江湖 發(fā)表于 07-10 11:12 ?2733次閱讀
基于FPGA的SSD目標(biāo)檢測算法設(shè)計

基于FPGA的壓縮算法設(shè)計

本設(shè)計中,計劃實現(xiàn)對文件的壓縮及解壓,同時優(yōu)化壓縮中所涉及的信號處理和計算密集型功能,實現(xiàn)對其的加速....
的頭像 FPGA技術(shù)江湖 發(fā)表于 07-10 11:09 ?2563次閱讀
基于FPGA的壓縮算法設(shè)計

一種集成FPGA和DSP芯粒的異構(gòu)系統(tǒng)級封裝

將多個異構(gòu)芯粒集成在一起進行封裝是一種具有廣闊前景且成本效益高的策略,它能夠構(gòu)建出既靈活又可擴展的系....
的頭像 FPGA技術(shù)江湖 發(fā)表于 07-03 09:23 ?2152次閱讀
一種集成FPGA和DSP芯粒的異構(gòu)系統(tǒng)級封裝

FPGA遠(yuǎn)程燒寫bit文件和調(diào)試ILA指南

在 FPGA 開發(fā)過程中,燒寫bit文件和使用ILA進行調(diào)試是再常見不過的操作。但如果 FPGA 板....
的頭像 FPGA技術(shù)江湖 發(fā)表于 06-05 16:41 ?2772次閱讀
FPGA遠(yuǎn)程燒寫bit文件和調(diào)試ILA指南

一文詳解JESD204B高速接口協(xié)議

JESD204B是邏輯器件和高速ADC/DAC通信的一個串行接口協(xié)議,在此之前,ADC/DAC與邏輯....
的頭像 FPGA技術(shù)江湖 發(fā)表于 04-24 15:18 ?5290次閱讀
一文詳解JESD204B高速接口協(xié)議

詳解Xilinx的10G PCS PMA IP

如果要在Xilinx的FPGA上使用萬兆以太網(wǎng)通信,大致有三種方法構(gòu)建協(xié)議棧。第一種使用GTX等Se....
的頭像 FPGA技術(shù)江湖 發(fā)表于 04-18 15:16 ?2164次閱讀
詳解Xilinx的10G PCS PMA IP

FPGA Verilog HDL語法之編譯預(yù)處理

Verilog HDL語言和C語言一樣也提供了編譯預(yù)處理的功能?!熬幾g預(yù)處理”是Verilog HD....
的頭像 FPGA技術(shù)江湖 發(fā)表于 03-27 13:30 ?1612次閱讀
FPGA Verilog HDL語法之編譯預(yù)處理

ISERDESE2原語端口及參數(shù)介紹

前面在講解HDMI接口之前,講解過IDDR、ODDR、OSERDESE2、IBUF等原語,之后一直有....
的頭像 FPGA技術(shù)江湖 發(fā)表于 03-17 10:52 ?2825次閱讀
ISERDESE2原語端口及參數(shù)介紹

FPGA標(biāo)準(zhǔn)庫Open Logic介紹

在現(xiàn)代技術(shù)發(fā)展的浪潮中,開源項目已經(jīng)成為了推動技術(shù)創(chuàng)新和發(fā)展的核心力量。無論是人工智能、區(qū)塊鏈、云計....
的頭像 FPGA技術(shù)江湖 發(fā)表于 03-17 10:21 ?1126次閱讀
FPGA標(biāo)準(zhǔn)庫Open Logic介紹

如何通過串口將8路adc采集的數(shù)據(jù)傳輸給上位機顯示

01 概括 ? 前文提供了ad7606的驅(qū)動程序,本文通過串口將8路adc采集的數(shù)據(jù)傳輸給上位機顯示....
的頭像 FPGA技術(shù)江湖 發(fā)表于 03-14 09:09 ?1798次閱讀
如何通過串口將8路adc采集的數(shù)據(jù)傳輸給上位機顯示

基于FPGA的FIR數(shù)字濾波器設(shè)計

在現(xiàn)代通信信號處理領(lǐng)域中,隨著各種精密計算和快速計算的發(fā)展對信號處理的實時性、快速性的要求越來越高。....
的頭像 FPGA技術(shù)江湖 發(fā)表于 03-06 12:31 ?2162次閱讀
基于FPGA的FIR數(shù)字濾波器設(shè)計

DeepSeek接入到VSCode實現(xiàn)提詞及代碼助寫

在AI大火之后,AI代碼一直是討論的熱題,之前比較火的cursor就是基于此出現(xiàn)的,但是國內(nèi)訪問受限....
的頭像 FPGA技術(shù)江湖 發(fā)表于 03-01 15:50 ?1905次閱讀
DeepSeek接入到VSCode實現(xiàn)提詞及代碼助寫

使用DDS生成三個信號并在Vivado中實現(xiàn)低通濾波器

本文使用 DDS 生成三個信號,并在 Vivado 中實現(xiàn)低通濾波器。低通濾波器將濾除相關(guān)信號。
的頭像 FPGA技術(shù)江湖 發(fā)表于 03-01 14:31 ?2951次閱讀
使用DDS生成三個信號并在Vivado中實現(xiàn)低通濾波器